所以你创造了一个PCB原理图使用OrCAD捕获，您已经准备好使用PCB布局工具将您的设计带到电子设计自动化(EDA)过程的下一步。你会怎么做?
如果你和大多数PCB设计师一样，很有可能你查了快速2分钟教程视频，生成所需的“网络列表”，并将其集成到您选择的PCB布局工具中，然后直接进行设计。
但如果你好奇什么是网列表，以及创建中间文件时在幕后发生了什么，这篇文章就是为你准备的。
什么是网表?
看一下示意图，思考一下。如果必须手动将最重要的信息从原理图转移到更全面的PCB布局工具中，那么最有效的方法是什么?
您可以去掉示意图中的所有视觉元素，只关注组件之间的连接传输。如果网是两个元件之间的连接，则网表就是描述电路的电气连接的列表。
在格式和所传递的信息量方面，网列表可以有很大的不同。下面是一个将包含在网络列表中的信息类型的例子:
参考指示器(例如，用于电容器的第一个实例的C1)
密码
信号关键词(如GND)
下面是由OrCAD Capture以PADS-PCB格式生成的一个简单的网络列表示例:
*信号* NET1
U2.7 c2.2 u3.3 c1.2 u1.5
即使您以前从未遇到过特定的格式，Netlists也非常容易阅读。在上面的NET1中，我们可以看到，C2.2指的是电容器的第二个实例的引脚2，该电容器被电连接到给定通用指示器U2的一个部件的引脚7。
在netlist之前会有一个部件列表，告诉您每个指示器指的是什么，在本例中，U2指的是一个双内联包。
网表文件的变化
了解如何读取网络列表将帮助您排除在使用第三方库的网络列表时发生的错误。修改网表的常见原因包括:
特殊字符
密码更改
冗余的网络名称
记录您对网络列表所做的任何更改是很重要的。如果在集成过程中遇到错误，那么在开始设计布局之前，有必要检查是否存在任何特殊字符违规、pin号不匹配或冗余网名。
避免违反网络列表的另一种方法是坚持相同的方法EDA软件生态系统。OrCAD Capture与OrCAD PCB Editor和更全面的Cadence Allegro PCB布局工具无缝集成。看看Cadence的PCB设计和分析工具套件今天。
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